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[主观题]

设计一个可控同步计数器,M1、M2为控制信号,要求: (1)M1M2=00时,维持原状态; (2)M1M2=01时,实现模2计数; (

设计一个可控同步计数器,M1、M2为控制信号,要求:

(1)M1M2=00时,维持原状态;

(2)M1M2=01时,实现模2计数;

(3)M1M2=10时,实现模4计数;

(4)M1M2=11时,实现模8计数。

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第1题
设计一个可控进制计数器,当控制输入M=0时为七进制计数,当M=1时为十三进制计数。 (1)试用MSI

设计一个可控进制计数器,当控制输入M=0时为七进制计数,当M=1时为十三进制计数。 (1)试用MSI计数器设计该可控计数器。 (2)用VHDL语言设计该可控计数器。

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第2题
用74194设计一个可控计数器,计数器有一个控制端X,当X=0时,电路为一个4位能自启动的环形计数器,其计数有效循
环如图(a)所示;当X=1时,电路为一个4位能自启动的环形计数器,其计数有效循环如图(b)所示。要求写出设计过程,画出电路图(设计可加必要的门电路,两循环之间允许有过渡状态)。

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第3题
用D触发器设计一个同步加法计数器,M为进位控制端,当M=1时为三进制计数器,当M=0时为四进制计数器,C为进位输

出端。

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第4题
用一片如图A1-4所示的4位二进制加法计数器74161和必要的逻辑门电路设计一个可控计数器,要求当控制信号M=1时

用一片如图A1-4所示的4位二进制加法计数器74161和必要的逻辑门电路设计一个可控计数器,要求当控制信号M=1时,实现七进制计数器;而当控制信号M=0时,实现十三进制计数器。画出所设计的可控计数器的逻辑电路。

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第5题
设计一个可变进制的同步计数器。它有一个控制端M:当M为0时,实现7进制计数器;M为1时,实现5进制计数器。请用D触

发器和门路电路(门电路类型不限)实现,画出最简逻辑图,并验证能否自启动(若不能自启动,不必修改成自启动电路)。

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第6题
用74194和门电路构造一个可控计数器,当控制信号A为0时是四位右移环形计数器;当控制信号A为1时是四位左移环
形计数器。
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第7题
图6.24所示电路是用二一十进制优先编码器74LS147和同步十进制计数器74160组成的可控分频器,试说明当输入控

制信号A、B、C、D、E、F、G、H、I分别为低电平时由Y端输出的脉冲频率各为多少?已知CLK端的输入脉冲频率为10kHz。

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第8题
用触发器实现同步时序电路。 (1)用J-K触发器设计一个模为8的格雷码同步计数器。 (2)用D

用触发器实现同步时序电路。 (1)用J-K触发器设计一个模为8的格雷码同步计数器。 (2)用D触发器设计上述题目。 (3)几点说明。

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第9题
试以同步二进制计数器74161为核心设计一个模10计数器,要求计数器按下列规律技术,并要求:(1)电路具有开机清

试以同步二进制计数器74161为核心设计一个模10计数器,要求计数器按下列规律技术,并要求:(1)电路具有开机清零功能;(2)写出电路设计过程并画出完整电路图(电路设计可加门和MSI组合逻辑电路)。

0,1,3,5,7,9,2,4,6,8,0,1,3,…

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第10题
设计一个采用主从JK触发器组成的同步三位二进制加法计数器。

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第11题
用JK触发器设计一个如图所示功能的同步五进制计数器,要求具有自启动能力。

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