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第1题
能否用一片4位并行加法器74LS283将余3代码转换成8421的二－十进制代码？如果有可能，应当如何连线？
能否用一片4位并行加法器74LS283将余3代码转换成8421的二-十进制代码？如果有可能，应当如何连线？
第3题
试用4位并行加法器74LS283设计一个加／减运算电路。当控制信号K=0时将两个输入的4位二进制数相加，而K=1时它将
试用4位并行加法器74LS283设计一个加/减运算电路。当控制信号K=0时将两个输入的4位二进制数相加，而K=1时它将两个输入的4位二进制数相减，允许附加必要的门电路。
第4题
试用4位并行加法器74LS283设计一个加／减运算电路。当控制信号M＝0时它将两个输入的4位二进制数相加，而M=1时它
试用4位并行加法器74LS283设计一个加/减运算电路。当控制信号M＝0时它将两个输入的4位二进制数相加，而M=1时它将两个输入的4位二进制数相减。两数相加的绝对值不大于15。允许附加必要的门电路。
第6题
设计逻辑电路用4位全加器74LS283完成4位余3码的全加器，可增加门电路或中规模器件实现电路，如编码器74LS148、
数据选择器74LS151、译码器74LS138、4位全加器74LS283，所用器件数不限。
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第7题
用两片4位数值比较器74HC85实现三个4位二进制数A=A3A2A1A0，B=B3B2B1B0，C=C3C2C1C0的并行比较。要求给出“A最
用两片4位数值比较器74HC85实现三个4位二进制数A=A3A2A1A0，B=B3B2B1B0，C=C3C2C1C0的并行比较。要求给出“A最大”、“A最小”和“三个数相等”三个输出信号，必要时可用门电路。
第11题
在4位逐次逼近型ADC中，设UR＝10V，UI＝8.2V，试说明逐次比较的过程和转换的结果。
在4位逐次逼近型ADC中，设UR＝10V，UI＝8.2V，试说明逐次比较的过程和转换的结果。
