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[主观题]

画出由与非门构成的基本RS触发器输出端Q和的电压波形,输入端和的电压波形分别如图题4.1(a)、(b)所示。

画出由与非门构成的基本RS触发器输出端Q和的电压波形,输入端和的电压波形分别如图题4.1(a)、(b)所示。画出由与非门构成的基本RS触发器输出端Q和的电压波形,输入端和的电压波形分别如图题4.1(a)、(b画出由与非门构成的基本RS触发器输出端Q和的电压波形,输入端和的电压波形分别如图题4.1(a)、(b

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第1题
同步计数器是指( )的计数器。

A.由同类型的触发器构成

B.各触发器时钟端连在一起,统一由系统时钟控制

C.可用前级的输出做后级触发器的时钟

D.可用后级的输出做前级触发器的时钟

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第2题
输入信号A的波形和CP的波形如图5-47所示,试画出该电路中触发器输出Q的波形(初始状态为0)。

输入信号A的波形和CP的波形如图5-47所示,试画出该电路中触发器输出Q的波形(初始状态为0)。

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第3题
D触发器的CP和D的波形如图4.2.59所示,分别画出正边沿和负边沿两种触发方式的Q端波形,设Q初态为0。

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第4题
下图为由555定时器构成的单稳态触发器,已知VDD=10V,R=10kΩ,C=0.1μF,求输出脉冲的宽度,试对应地画出输出VC、V

下图为由555定时器构成的单稳态触发器,已知VDD=10V,R=10kΩ,C=0.1μF,求输出脉冲的宽度,试对应地画出输出VC、Vo的波形。

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第5题
今有TTL、JK触发器各一个,一个是主从触发方式,另一个是下降边沿触发方式。己知两者输入波形如图4.2.73所示,试
画出在输入信号作用下每个触发器Q端输出波形。

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第6题
图题4.18所示是用CMOS边沿触发器和或非门组成的脉冲分配电路。试画出在一系列CP脉冲作用下Q1、Q2和Z端对应的

图题4.18所示是用CMOS边沿触发器和或非门组成的脉冲分配电路。试画出在一系列CP脉冲作用下Q1、Q2和Z端对应的输出电压波形。设触发器的初始状态为Q=0。

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第7题
在教材图15.4.1所示的分压式偏置放大电路中,已知UCC=24V,RC=3.3kΩ,RE=1.5kΩ,RB1=33kΩ,RB2=10kΩ,RL=5.1kΩ,晶

在教材图15.4.1所示的分压式偏置放大电路中,已知UCC=24V,RC=3.3kΩ,RE=1.5kΩ,RB1=33kΩ,RB2=10kΩ,RL=5.1kΩ,晶体管的β=66,并设RS≈0。(1)试求静态值IB,IC和UCE;(2)画出微变等效电路;(3)计算晶体的输入电阻rbe;(4)计算电压放大倍数Au;(5)计算放大电路输出端开路时的电压放大倍数,并说明负载电阻RL对电压放大倍数的影响;(6)估算放大电路的输入电阻和输出电阻。

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第8题
在RD=SD=“1”时,基本RS触发器()。(A)置“O”(B)置“1”(C)保持原状态(D)不停地翻转

在RD=SD=“1”时,基本RS触发器()。

(A)置“O”

(B)置“1”

(C)保持原状态

(D)不停地翻转

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第9题
电路及输入波形如图所示,其中FF1是D锁存器,FF2是维持-阻塞D触发器,根据CP和D的输入波形画出Q1和Q2的输出波

电路及输入波形如图所示,其中FF1是D锁存器,FF2是维持-阻塞D触发器,根据CP和D的输入波形画出Q1和Q2的输出波形。设触发器的初态均为0。

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第10题
在上题中,设RS=1kΩ,试计算输出端接有负载时的电压放大倍数和,并说明信号源内阻RS对电压放大倍数的影响。

在上题中,设RS=1kΩ,试计算输出端接有负载时的电压放大倍数,并说明信号源内阻RS对电压放大倍数的影响。

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第11题
试用JK触发器设计一个变模计数器,要求: (1)控制端X=0时,计数器的模M=3,计数规律为

试用JK触发器设计一个变模计数器,要求: (1)控制端X=0时,计数器的模M=3,计数规律为

(2)控制端X=1时,计数器的模M=4,计数规律为

试画出逻辑电路图。

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