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用D触发器设计一个脉冲异步模7计数器。

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第1题
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第2题
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第3题
用触发器实现同步时序电路。 (1)用J-K触发器设计一个模为8的格雷码同步计数器。 (2)用D

用触发器实现同步时序电路。 (1)用J-K触发器设计一个模为8的格雷码同步计数器。 (2)用D触发器设计上述题目。 (3)几点说明。

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第4题
设计一个模60加/减可逆计数器至少需要多少个触发器( )。

A.6个

B.5个

C.7个

D.12个

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第5题
试用JK触发器设计一个变模计数器,要求: (1)控制端X=0时,计数器的模M=3,计数规律为

试用JK触发器设计一个变模计数器,要求: (1)控制端X=0时,计数器的模M=3,计数规律为

(2)控制端X=1时,计数器的模M=4,计数规律为

试画出逻辑电路图。

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第6题
用最少的D触发器及适当的小规模门电路设计7进制同步加法计数器,要求电路能自启动,写出状态方程,并画出状态
转换图及相应的电路图。
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第7题
用D触发器和门电路设计一个十一进制计数器,并检查设计的电路能否自启动。

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第8题
用D触发器和门电路设计一个十一进制计数器,并检查设计的电路是否自动启动。

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第9题
用下降沿触发的边沿D触发器和与非门设计一个同步七进制加法计数器。

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第10题
设计一个可变进制的同步计数器。它有一个控制端M:当M为0时,实现7进制计数器;M为1时,实现5进制计数器。请用D触

发器和门路电路(门电路类型不限)实现,画出最简逻辑图,并验证能否自启动(若不能自启动,不必修改成自启动电路)。

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第11题
用下降沿触发的边沿JK触发器和与非门设计一个同步七进制加法计数器。

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