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中规模集成同步4位二进制加法计数器74LS161的功能表如下表所示,要求: CP bar{CR} bar{LD} CTP

中规模集成同步4位二进制加法计数器74LS161的功能表如下表所示,要求:

CPbar{CR}bar{LD}CTPCTTD0D1D2D3Q0n+1Q1n+1Q2n+1Q3n+1
×0 ×× ×× × × ×0 0 0 0
1 0× ×d0d1d2d3d0d1d2d3
×1 10 ×× × × ×保 持
×1 1× 0× × × ×保 持
1 11 1× × × ×4位二进制加法计数器

进位输出:CO=CTTQ3Q2Q1Q0

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第1题
用一片如图A1-4所示的4位二进制加法计数器74161和必要的逻辑门电路设计一个可控计数器,要求当控制信号M=1时

用一片如图A1-4所示的4位二进制加法计数器74161和必要的逻辑门电路设计一个可控计数器,要求当控制信号M=1时,实现七进制计数器;而当控制信号M=0时,实现十三进制计数器。画出所设计的可控计数器的逻辑电路。

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第2题
两片4位同步二进制计数器74161接成如图所示的电路。

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第3题
试分析如图所示由4位二进制同步计数器74161组成的电路。

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第4题
试用4位同步二进制计数器74LS161接成十二进制计数器,标出输入、输出端,可以附加必要的门电路。

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第5题
由16×4位ROM和4位二进制加法计数器74LS161组成的脉冲分配电路如图7-13所示,ROM输入和输出关系如表7-4所示。

由16×4位ROM和4位二进制加法计数器74LS161组成的脉冲分配电路如图7-13所示,ROM输入和输出关系如表7-4所示。试画出在CLK信号作用下D3、D2、D1、D0的波形。

表7-4 R0M输入和输出关系

地址输入数据输出
A3A2A1A0D3D2D1D0
0

0

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1

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第6题
试用4位二进制计数器芯片74LS161设计一个十三进制加计数器。

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第7题
n位的二进制加法计数器,能计数的最大十进制数是多少?如果要计数的十进制数为100,需要几位二进制加法计数器?
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第8题
画出用4位二进制计数器74LS161按异步清零法实现下列进制计数器的电路图。
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第9题
一个五位的二进制加法计数器,初始状态为00000,问经过201个输入脉冲后,此计数器的状态为______。

A.00111

B.00101

C.01000

D.01001

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第10题
用下降沿触发的边沿D触发器和与非门设计一个同步七进制加法计数器。

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第11题
用下降沿触发的边沿JK触发器和与非门设计一个同步七进制加法计数器。

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